Рефераты для студентов и школьников!

История государства и права зарубежных стран

Маркетинг, товароведение, реклама

Теория государства и права

Искусство

Техника

История

Религия

История экономических учений

Литература, Лингвистика

Программирование, Базы данных

История отечественного государства и права

Гражданская оборона

Охрана природы, Экология, Природопользование

Психология, Общение, Человек

Философия

Биология

Астрономия

Социология

Транспорт

Программное обеспечение

Экономическая теория, политэкономия, макроэкономика

Математика

Физика

География, Экономическая география

Гражданское право

Политология, Политистория

Физкультура и Спорт

Микроэкономика, экономика предприятия, предпринимательство

Менеджмент (Теория управления и организации)

Здоровье

Банковское дело и кредитование

Экскурсии и туризм

Международные экономические и валютно-кредитные отношения

Банковское право

Компьютеры и периферийные устройства

Культурология

Историческая личность

Металлургия

Радиоэлектроника

Конституционное (государственное) право России

История политических и правовых учений

Технология

Компьютеры, Программирование

Конституционное (государственное) право зарубежных стран

Право

Бухгалтерский учет

Уголовное право

Материаловедение

Москвоведение

Музыка

Трудовое право

Экономика и Финансы

Страховое право

Налоговое право

Компьютерные сети

Административное право

Муниципальное право России

Нотариат

Ценные бумаги

Педагогика

Медицина

Финансовое право

Химия

Архитектура

Уголовный процесс

Юридическая психология

Законодательство и право

Военная кафедра

Римское право

Криминалистика и криминология

Промышленность и Производство

Экологическое право

Государственное регулирование, Таможня, Налоги

Астрономия, Авиация, Космонавтика

Иностранные языки

Сельское хозяйство

Шифраторы, дешифраторы, триггеры

Шифраторы, дешифраторы, триггеры

Очевидно, если убрать шину синхроимпульсов и снизить пороги элементов на единицу, то получим асинхронный дешифратор с выходными двухвходовыми элементами. На рисунке 2 показан другой вариант асинхронного двоично-восьмеричного дешифратора, в котором используются только прямые значения аргументов.

Однако недостатком, как этой, так и предыдущей схемы можно считать то, что в них используются разнотипные элементы.

Рис. 5. Синхронный восьмерично-двоичный шифратор на МЭ
Рис. 6. Электрическая схема восьмерично-двоичного шифратора на переключателях тока
Рис. 4. Асинхронный Восьмерично-двоичный шифратор
При использовании многовходовых ПЭ с прямым и инверсным выходами дешифратор можно построить на однотипных элементах. На рисунке 3 показан двоично-восьмеричный дешифратор, построенный на однотипных ПЭ, каждый из которых имеет четыре входа с весами +1 и один вход с весом –1, порог +2, прямой и инверсный выходы.

Необходимые функции дешифратора (1-1) этим элементом реализуются путём подключения некоторых входов к постоянным логическим уровням 0 или 1 и снятия информации с прямого или инверсного выхода элемента.

Многоступенчатые дешифраторы на ФН и ПЭ строятся точно так же, как на булевых элементах.

Поэтому их не будем рассматривать.

Рис. 3. Асинхронный дешифратор на однотипных ПЭ входа входа
В ряде случаев с целью экономии оборудования выгодно дешифратор реализовать не на стандартных логических элементах, а в виде специальной схемы, помещаемой в одном корпусе.

Шифратор выполняет противоположную дешифратору функцию, то есть преобразует одноразрядный код с основанием Е=2 n в n -разрядный двоичный код. При построении шифратора на ПЭ и ФН можно использовать элементы, реализующие функцию ИЛИ, с прямыми и инверсными выходами. На рисунке 4 показан пример такого восьмерично двоичного шифратора. На рисунке 5 показан шифратор, построенный на мажоритарных элементах «2 или более из 3». Выходы МЭ (мажоритарные элементы) попарно объединены, т.е. на выходах реализована операция ИЛИ по высокому уровню (монтажное ИЛИ). Этот шифратор работает по синхронному принципу, то есть двоичный код появляется на его выходе только при поступлении синхроимпульса. При построении многовходового шифратора, как и в случае булевых элементов, можно использовать многовходовые сборки или построить многоступенчатую схему.

Рис 2-2. Синхронные RS -триггеры
Рис. 2-1. Асинхронные RS -триггеры
Учитывая возможности современной интегральной технологии, шифраторы выгоднее реализовать не на логических элементах, а в виде специальной микросхемы. При этом получается большой выигрыш в оборудовании. На рисунке 6 приведена электрическая схема шифратора, которая пригодна для интегрального исполнения и совместима со схемами нейронных элементов. ТРИГГЕРЫ Существуют различные типы триггеров на потенциальных элементах: RS -триггеры (синхронные и асинхронные), D -триггеры типов Latche и Edge , RST -, D -, и JK -триггеры типа ведущий-ведомый ( Master - Slave ) и так далее.

Рассмотрим примеры построения таких триггеров на НЛЭ (нейронные логические элементы). Функцию асинхронного RS -триггера аналитически можно описать следующим образом: p =0, если R =1, S =1 является запрещённой, то есть R x 1 S x 2 , Q ( t ) x 3 , Q ( t +1)= F , получим: Изображая эту функцию в виде точечной диаграммы, а затем преобразуя её в пороговую диаграмму и синтезируя ФНО по алгоритму синтеза ФН, получим простейшую схему RS -триггера, показанную на рисунке 2-1а.

Нетрудно проверить, что при отсутствии сигналов R и S ( R = S =0) единичное состояние триггера, то есть возбуждённое состояние нейрона, устойчиво благодаря обратной связи с прямого выхода.

Нулевое состояние триггера также устойчиво, так как оно соответствует невозбуждённому состоянию нейрона. При поступлении сигнала R =1 или S =1 состояние нейрона, следовательно, состояние триггера изменяется. По функции(2-2) можно синтезировать также другие варианты RS -триггера на ФНР, ФНЗ или ФНО, но они не проще данной схемы.

Допустим в триггере разрешается комбинация R = S =1, то есть p =1. Тогда из (2-1) будем иметь: Пользуясь алгоритмом синтеза оптимального нейрона, получим простейший ФН, реализующий эту функцию, то есть схему RS -триггера, которая показана на рисунке 2-1б. Как видно, здесь вместо ФН получен ПЭ. Однако при технической реализации этот ПЭ требует больше компонентов (транзисторов и резисторов), чем ФН, показанный на рисунке 2-1а, так как ПЭ имеет три синаптических входа, а ФН - два (один синаптический вход требует четыре компонента). Элемент ИЛИ в ФН добавляет на синаптический вход всего один транзистор. Если полученную согласно (2-3) точечную диаграмму подвергать преобразованию типа P x 1 x 1 – то получим новую точечную диаграмму, по которой, синтезируя минимальный нейрон, получим схему RS -триггера, показанную на рисунке 2-1в. Как видно, здесь уже требуется один МЭ «2 или более из 3». В этой схеме вход R работает по негативной логике, то есть логической единице соответствует низкий потенциал.

Работу синхронного RS -триггера аналитически можно представить следующей системой функций: (2-4) где логическая переменная С соответствует синхроимпульсу.

Каждая из этих формул представляет функцию трёх переменных и выражается соответствующей точечной диаграммой.

Синтезируя ФН, реализующие эти функции, получим два идентичных ПЭ с весами +1, +1, +2 и порогом +2. Оба эти ПЭ имеют общую входную переменную С, а по другим аргументам отличаются.

Соединяя эти два ПЭ в соответствии с (2-4), получим схему синхронного RS -триггера, показанную на рисунке 2-2б. Если по функции (2-5) синтезировать ФНО, то получается нейрон с аналогичной структурой и другой полярностью синхроимпульса. Здесь и далее принимается, что вход (синапс) НЛЭ возбуждён, если на него подан высокий уровень потенциала.

Рис. 2-3. Простые RSD -триггеры (защёлки)
На рисунке 2-3 приведены схемы простых D -триггеров с R и S входами на ПЭ и ФН. Схемы построены таким образом, что в них полностью отсутствует соревнование (гонка) сигналов. В схемах входы R и S работают по асинхронному принципу, а информационный сигнал D записывается в триггер только при поступлении синхроимпульса. В схеме рисунка 2-3а, вход R работает по негативной логике, т.е. в нормальных условиях при отсутствии сигнала Уст. 0 на входе R имеется высокий уровень потенциала. Здесь используются как прямые, так и инверсные значения синхроимпульсов. В схеме рисунка 2-3б, прямым выходом триггера служит инверсный выход нейрона.

Наиболее простой с точки зрения технической реализации является схема рисунка 2-3б.

Рассмотрим работу схемы рисунка 2-3б. При отсутствии входных сигналов схема может находиться в одном из двух устойчивых состояний – нейрон возбуждён ( Q =0) и не возбуждён ( Q =1). При Q =0, благодаря обратной связи, суммарная активность ( ) синапсов равна +2 или +1 в зависимости от того, что имеется на информационном входе D . Поскольку Допустим Q =1, D =0б то есть нейрон не возбуждён и на информационном входе имеется низкий потенциал. При поступлении синхроимпульса в нейроне возбуждаются два синапса с весами +2 и –1. Поскольку С) в триггер записывается информация 0, имеющая на входе D . Если к моменту поступления следующего синхроимпульса информация на входе D не изменяется, то состояние 0 триггера также не изменится.

Допустим теперь информация на входе сменилась ( D =1). Тогда, поскольку С отсутствует, состояние триггера не изменяется, так как в нейроне снова возбуждены два синапса с весами –1 и +2 и С в нейроне оказываются возбуждёнными все три синапса и, поскольку В этой схеме, если на информационный вход триггера подавать сигнал и поменять местами выходы, получится D -триггер, информационный вход которого работает по негативной логике.

Рассмотрим триггеры со счётными входами, или так называемые Т-триггеры. В простейшем случае Т-триггер можно построить на двух RS -триггерах типа рисунка 2-2а, с добавлением некоторых входов или вентилей, как это делается обычно при построении Т-триггера на булевых элементах.

Однако при этом потребуются 4-6 элементов, то есть схема получается сложной. На рисунке 2-4 показана схема счётного триггера, построенная на трёх мажоритарных элементах. Для работы в счётном режиме на управляющие входы y 1 и y 2 подаётся постоянно высокий уровень потенциала 1. При каждом поступлении счётного сигнала Т выход Q -триггера переключается в противоположное состояние, причём рабочим перепадом является отрицательный перепад счётного сигнала, то есть триггер работает по принципу Master - Slave , МЭ 1 и МЭ 2 образуют ведущий триггер, а МЭ 3 -ведомый. На рисунке 2-4 справа показана временная диаграмма работы триггера.

Максимальная частота переключения этого триггера в счётном режиме равна:

Рис. 2-5. T -триггеры типа MS на ФН
Ти RST -триггеров, построенных на двух ФНР и ФНО соответственно. Обе схемы работают согласно временной диаграмме, приведённой на рисунке 2-5 внизу.

Верхний нейрон Н м реагирует на положительный перепад счётного сигнала и называется ведущим ( Master ) элементом, а нижний нейрон Н s реагирует на отрицательный перепад счётного сигнала и называется ведомым ( Slave ) элементом.

Ведомый нейрон Н s напоминает предыдущее состояние триггера на время, равное длительности запускающего сигнала. Это свойство схемы в некоторый момент времени содержать в себе информацию как о текущем, так и о предыдущем состоянии – очень важно. Как будет показано далее, оно широко используется при построении логических устройств на таких триггерах.

Рассмотрим работу триггера рисунка 2-5а.

Допустим, что триггер находится в состоянии 0, то есть Q ’= Q =0, и на вход Т поступает сигнал (высокий потенциал). Этот сигнал возбуждает нейрон Н м через синапс с весом +1, а нейрон Н s остаётся в невозбуждённом состоянии, поскольку в нём до переключения Н м возбуждены два синапса с весами +1 и –2 и суммарная активность Н м возбуждены все три синапса с весами +1 и –2 и суммарная активность Т стоит высокий потенциал, Н м находится в возбуждённом состоянии, а Н s – в невозбуждённом. После снятия сигнала на входе Т (подан низкий потенциал) нейрон Н s также переходит в возбуждённое состояние благодаря синапсу, связанному с выходом Q ’, а нейрон Н м не изменяет своего состояния.

Следовательно, за один период входного сигнала триггер переключается полностью из состояния 0 в состояние 1. Обратное переключение из состояния 1 в состояние 0 происходит аналогичным образом.

Максимальное быстродействие триггера на рисунке 2-5 в счётном режиме равно: R - и S - входы триггера работают по асинхронному принципу.

Рис. 2-6. D -триггер типа MS с парафазным входом
На рисунке 2-6 показан ведущий-ведомый ( Master - Slave ) D -триггер (далее будем называть MSD -триггером) с пара фазным входом и временная диаграмма его работы. При поступлении синхроимпульса его положительный перепад записывает информацию D в ведущем нейроне Н м , при этом состояние ведомого нейрона остаётся прежним.

Отрицательный перепад синхроимпульса, состояние ведущего нейрона записывает в ведомом нейроне Н s . Как видно, информация на выходе этого триггера появляется с задержкой, равной длительности синхроимпульса.

Поэтому этот триггер иногда называют также задержанным D -триггером в отличие от простого D -триггера. Как известно, универсальным типом триггера является JK -триггер, который может работать как в режиме синхронного RS -триггера, так и в режиме Т-триггера и MSD -триггера.

Рассмотренный на рисунке 2-4 Т-триггер можно превратить в JK -триггер, если на управляющие входы y 1 и y 2 подать сигналы J и K соответственно, а на вход Т подать синхроимпульсы. Если же на вход у 1 подать сигнал D , а на вход y 2 - сигнал MSD -триггер с парафазным входом. На рисунке 2-7 приведена схема JK -триггера на ИЛИ – нейронах. Хотя в схеме используются прямое и инверсное значения тактирующего сигнала, но соревнование (гонка) сигналов полностью отсутствует. При J = K =1 тактирующий сигнал не влияет на триггер. Если J = K =0 или эти входы объединены с входом Т-триггер. В остальных случаях тактирующий сигнал записывает входную информацию в триггер, причём снова верхний нейрон является ведущим, а нижний - ведомым.

Рис. 2-7. JK -триггер типа MS на ФНО
Рассмотрим работу приведённого JK -триггера. В исходном состоянии отсутствует тактирующий сигнал, то есть C =0, а Q = Q ’=0. Н м не возбуждён, так как в нём возбуждены один положительный и один отрицательный входы, сумма весов которых меньше порога (+1). Следовательно, состояние Н м устойчивое. В Н s возбуждён отрицательный вход, связанный с Н s также устойчивое.

Аналогичным образом устойчиво также единичное состояние триггера, когда Q = Q ’=1, благодаря обратным связям с прямых выходов нейронов к своим же положительным входам. При отсутствии тактирующего сигнала (С=0) изменение информации на входах J и K не влияет на триггер.

оценка стоимости аренды помещения в Орле
оценка аренды в Брянске
оценка авто для наследства в Смоленске

Подобные работы

История процессоров

echo "Несмотря на то что AMD это практически отпочковавшийся от Intel младший брат их пути расходятся как в маркетинговой так и технологической нишах. Сейчас наблюдается явное противостояние двух сил

Шифраторы, дешифраторы, триггеры

echo "Очевидно, если убрать шину синхроимпульсов и снизить пороги элементов на единицу, то получим асинхронный дешифратор с выходными двухвходовыми элементами. "; echo ''; echo ""; echo ''; echo ""; e

Средства мультимедиа

echo "Рассмотрим понятие виртуальная реальность немного подробнее, поскольку оно часто встречается в литературе, иногда не очень обоснованно. Термин этот предложил Jaron Lanier (Ланье), который опред

© 2011-2012, o